| Mode | Name | Size | |
|---|---|---|---|
| -rw-r--r-- | alu.v | 682 | logplain |
| -rw-r--r-- | alu_op_decode.v | 2183 | logplain |
| -rw-r--r-- | arithmetic_unit.v | 495 | logplain |
| -rw-r--r-- | clock_divider.v | 633 | logplain |
| -rw-r--r-- | control_unit.v | 3758 | logplain |
| -rw-r--r-- | cpu.v | 2819 | logplain |
| -rw-r--r-- | instruction_decode.v | 2492 | logplain |
| -rw-r--r-- | logic_unit.v | 282 | logplain |
| -rw-r--r-- | memory_unit.v | 1006 | logplain |
| -rw-r--r-- | ram.v | 648 | logplain |
| -rw-r--r-- | register_file.v | 2382 | logplain |
| -rw-r--r-- | rom.v | 376 | logplain |
| -rw-r--r-- | shift_unit.v | 312 | logplain |
| -rw-r--r-- | top.v | 448 | logplain |
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